طراحی یک مدار نمونه بردار و نگه دار با دقت ۱۲-bit جهت نرخ داده ۲۰۰ms/s

در این مقاله، یک مدار نمونه بردار و نگه دار تمام تفاضلی با دقت 12 بیت برای نرخ داده  200 ms/sارائه گردیده است. در مدار پیشنهادی این مقاله به منظور افزایش خاصیت خطی و همچنین افزایش میزان ولتاژ عملکرد، ازسوئیچ های بوت استرپ جهت نمونه برداری از سیگنال ورودی استفاده گردیده است. همچنین به منظور جلوگیری از اثر بارگذاری طبقات بعدی بر روی مدار پیشنهادی از یک بافر خروجی با بهره قابل تنظیم جهت افزایش خاصیت خطی استفاده گردیده است. عملکرد مدار پیشنهادی توسط نرم افزار hspice با استفاده از تکنولوژی cmos-0.35um مورد شبیه سازی قرار گرفته است که نتایج شبیه سازی، عملکرد مناسب مدار را جهت نرخ داده 200ms/s با دقت 12 بیت در خروجی تصدیق می کند.